米兰体育MILAN 如何制备数十亿晶圆凸块?

发布日期：2026-06-19 20:15    点击次数：90

搀杂键合时间带来的超高互连密度，前所未有。

搀杂键合时间可完了前所未有的信号互连节距，但若芯片裸片与中介层全面布设互伙同构、互连点间距仅1微米，单颗芯片的互连总量可达到数十亿个。面对如斯弘远的互连范围，一一检测、测试每个互连点已不具备可行性。想要保险该工艺的良率，既需要制程具备高度均匀性与可瞻望性，同期芯片架构也需具备模块化、可测试性与冗余开发智商。

新想科技I/O库IP家具市集总监Lakshmi Jain示意：“搀杂键合能完了极高密度的互连。一块布满芯粒、以1微米节距完成键合的好意思满尺寸中介层，里面互连点数目应付可达数十亿。在这么的制程范围下，制形成败不再取决于管控单个互连点，而是依靠架构层面的全局调控——架构需预设一定进程的制程残障，并具备残障容忍智商。”

搀杂键合可完了无凸块互连，互连节距覆盖10微米至1微米。以当下行业表率来看，1微米节距已是极高难度工艺，但这并非物理极限。EV Group业务拓展司理Thomas Pleschke以为更小的互连节距将冉冉落地：“表面上，咱们不详完成两片300毫米晶圆的键合，焊盘节距可达200纳米，举座互连点总量高达数万亿个。”

平面硅工艺的上风在于可并行制备海量互连点，因此无论互连总量是百万级一经十亿级，制程基础逻辑不变，竟然关节在于工艺均匀性。晶圆片内的制程偏差会对良率形成湮灭性影响。与此同期，在输入输出电路中集成配套测试电路，可完了键合前后的电性检测，保险互连可靠性。

数十亿互连点的完了门槛并不高

完了数十亿互连点的中枢，恰是搀杂键合所支抓的1微米互连节距。每毫米长度内可排布1000个“凸点”（业内虽风俗称其为凸点，但搀杂键合的中枢上风恰是取消传统凸块结构，直接纳场焊盘与焊盘贴合键合）。底下以一款封装决议例如阐明该逻辑。本次测算假定中介层可与基板完成搀杂键合；即便剔除该假定，最终论断也不会发生改革。

测算将取舍现存商用裸片尺寸看成参考，仅用于轨则裸单方面积，不代表该裸片原生互连点数目；咱们将基于裸片尺寸，推算搀杂键合工艺下可完了的互连总范围。

图1：用于统计互连点数目的处理器封装决议。若HBM4堆叠层数为16层，举座互连点总量可冲破260亿个。

测算选择市面现存裸片尺寸仅作面积参考，不代表裸片原生可用互连点数目，仅依托尺寸操办该规格裸片取舍搀杂键合后的互连上限。

示例封装内含8颗Intel Nova Lake处理器裸片，单颗裸片尺寸14.8×6.6平方毫米，单裸片互连点超9700万个，8颗处理器估计互连点7.81亿个；封装搭载12组16层堆叠HBM4，单颗DRAM裸片尺寸11×11平方毫米，对应互连点超230亿个；另有1颗参考AMD规格谋划的输入输出芯粒，尺寸一样为11×11平方毫米。中介层取舍三块光刻视场拼接谋划，单块视场28×33平方毫米，中介层举座互连点总量约25亿个。

将通盘器件互连点相加，举座封装互连总量达267亿个，其中绝大多数互连点来自HBM4存储堆叠。即便中介层无法与封装基板完了搀杂键合，整套封装互连点范围依旧看护数百亿级别。

该测算存在一定遐想化前提：HBM4堆叠可在裸片阶段、堆叠阶段完成两次电性检测后，再与中介层键合，但这无法改革一个行业趋势：单封装内完了数百亿互连点的时间决议很快将落地商用。

互连点范围达到百亿级后，工程师如何保证一起互连均可浮浅责任？搀杂键合互连尺寸微细、排布相配密集，键合完成后作念光学检测并不施行；即便仅排查开路、短路故障，逐点测试也会蹂躏大王人时辰，且很难完了每个互连点的单独电性引出。

想要取得踏实可靠的互连，需要满足两大中枢条目：一是整片晶圆的制程一致性极高，保证键合焊盘的刻蚀、金属填充均匀；二是芯片内置专用测试电路，让电性检测具备可落地性。

从泉源完了高品性制程

先进半导体制造最大挑战之一等于制程偏差。单颗裸片想要浮浅责任，其上通盘键合焊盘的制备工艺必须统统妥洽：包括氧化层滋长、通孔刻蚀、通孔金属填充，以及金属层回退——金属回退谋划是为了让氧化层先贴合、完成预键合。任性一处互连失效，王人会导致整颗裸片报废。

搀杂键合对制程环境要求严苛，是公认的高难度工艺，氧化层与铜金属的键合界面必须极致洁净，才调让两种材料无缝贴合，如同单一举座。Pleschke指出：“搀杂键合对名义预处理的表率十分尖刻，时时要求名义浮松度低于0.5纳米；等离子工艺气体种类、射频功率参数、处理时长王人是决定键合品性的中枢工艺主义。”

单颗大尺寸裸片内的工艺均匀性本就难以管控，而想要完了可不雅的晶圆良率，整片晶圆跨区域均匀性必须达到极高表率。均匀性无法澈底阻绝互连残障，但能大幅抑止故障概率，收缩后端电性测试的压力。

Pleschke补充说念：“化学机械抛光（CMP）设施中，铜凹下的高度、面貌、均匀度管控至关遑急。铜焊盘时时需回退3至5纳米，尺寸与散布保抓均匀（铜焊盘扩张总计约每微米铜厚、50摄氏度温升扩张1纳米）。”

并行化晶圆制程是中枢支抓

平面工艺的中枢上风是整片晶圆通盘裸片、通盘焊盘同步加工，前提是制程偏差可控。泛林集团先进封装董事总司理Chee Ping Lee示意：“百亿级互连点的量产落地，依托整套半导体产线的晶圆级并行加工智商，涵盖光刻、薄膜千里积、刻蚀全经由。介质层薄膜千里积是搀杂键合两片晶圆预贴合的基础；随后咱们取舍等离子刻蚀在介质层钻出通孔，通孔侧壁面貌高度可控、复刻光刻图形精度；终末并行完成数十亿通孔的金属填充，一次性形成好意思满互伙同构。”

Lee用一个平凡类比描摹该制程范围：“这就好比要在好意思国全境均匀降雨，精度达到每拆开一米抛弃的水桶，接水速度统妥洽致。”

为缩减堆叠高度（尤其HBM存储堆叠）、裁减互连走线长度，晶圆薄化工艺正在不休激动；临时键合材料（TBM）可将超薄晶圆固定在承载片上，保险制程踏实性。

布鲁尔科技期骗工程师Amit Kumar称：“基于搀杂键合的高带宽存储时间道路，需要将晶圆薄化至数十微米，以此裁减堆叠后的信号传输旅途。这对临时键合材料苛刻多重性能拘谨：需承受多轮堆叠键合轮回、具备踏实的机械与热学性能；晶圆举座厚度偏差（TTV）需限制高出低水平；同期材料名义易清洁、无颗粒残留。”

介质层材料性能至关遑急

相邻搀杂键合焊盘之间由介质层艰涩，互连间距缩小会加重信号串扰、劣化信号好意思满性，选择更低介电常数的介质材料可改善该问题。

Kumar解说：“输入输出电路密度栽植一个数目级，金属导体间距同步缩小。想要看护高频下的信号好意思满性，米兰体育中国官网介质材料必须具备极低的高频介电常数。”

互连节距缩小也会给介质层带来更大应力。Pleschke示意：“相较于大节距架构所用介质，末节距工艺配套介质需要承受更高机械应力、提供更强键合结合能，耐受铜焊盘之间介质疏忽缩小带来的应力增量。”

除此以外，铜金属会在部分介质中发生离子挪动。Pleschke补充：“器件尺寸微缩后，铜扩散成为新增可靠性风险，需选择适配介质加以遮蔽，典型材料包括SixNy、SiON、SiCN。但这类材料介电常数均高于二氧化硅（3.9~4.2）：SiON介电常数区间3.9~7.5，SiCN为4.0~9.0，氮化硅（Si₃N₄）为6.0~7.5。”

逐点检测决议已不成行

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Pleschke提到：“搀杂键合焊盘抓续缩小，不仅质检责任量大幅飞腾，配套检测斥地的开发门槛也同步举高。”

受限于互连尺寸与排布密度，光学检测妙技已不再适用。Lee指出：“搀杂键合完了的互连密度下，时间层面无法完了对每一个斗殴焊盘的颓败检测，这对量检测斥地厂商是巨大挑战。”

Lakshmi Jain认可该不雅点：“该密度下产生的残障多为局部电性故障，阐扬为键合弱贯穿、开路、性能临界，或是小范围连片失效，这类残障无法通过视觉检测识别。”

既然逐点检测不具备实操性，电性测试就成为筛选失效裸片的中枢妙技。裸片虽可在键合前单独完成测试，但键合后仍需复测，证明键合界面可靠。

以电性测试替代物理检测

这类芯片必须集成内置自测试（BiST）电路考证互连性能，同期配套冗余互伙同构与开发逻辑，用于开发检测出的故障互连点。

主流处罚决议是将输入输出端口分辩为颓败单位簇，每个单位簇配套好意思满测试电路，可颓败完成检测；通过复制单位簇，天真扩展互连总额量。新想科技3DIO IP等于该决议的典型案例：单个单位簇包含16组差分通说念（每组通说念双向各一枚焊盘），内置独赶快钟树，取舍双倍数据速度（DDR）时钟，数据传输速度可达4~6吉比特每秒；同期配套电源VDD、接地互连与静电保护电路。

Lakshmi Jain先容：“3DIO物理层IP不会单独考证每一条互连走线，而是将互连整合为表率化、可复制的微型单位簇，每个单位簇支抓颓败电性测试。镶嵌式内置自测试电路支抓键合前、键合后双阶段检测，可提前、精确定位键合残障。该物理层无绑定特定通讯公约、无需链路教练，制造测试时可径直不雅测时序性能，不受公约公法甩掉。”

对百亿级互连场景而言，该架构中枢上风是每个单位簇自带自测试模块、冗余贯通与开发功能，裸片可在键合前后自主完成互连自检。单位簇可通过编译器用天真建树，冗余贯通的布设范围可凭据家具需求退换；一朝检测出故障互连，开发机制可切换至备用贯通，扶持存在残障的裸片。

冗余谋划与开发机制不成或缺

测试检出的残障大多或然散布，冗余贯通开发机制可扶持本应报废的裸片。该机制需要预留备用焊盘，当主互连焊盘故障时完成贯通切换。

Lakshmi Jain称：“本色量产环境中，绝大多数良率损耗来自零碎散布的局部残障，而非系统性工艺故障。因此冗余贯通的布设比例高度取决于对应制程工艺、代工场固有残障特征，不存在一套通用冗余比例适配通盘家具谋划。”

新想科技单位簇架构将冗余资源集成在单位簇层级，新增单位簇即可同步扩容冗余智商，扩展性更强。“在物理层层面，咱们支抓制造级电性测试，精确定位故障通说念或单位簇，基于实测硅片数据启用开发、贯通重映射或冗余替换决议。单位簇化谋划可精确覆盖量产中常见的或然残障，同期幸免冗余电途经度谋划，形成面积蹂躏。”

始终可靠性保险

搀杂键合的可靠性犀利并存：上风在于器件、互连尺寸更小，表面上更容易完了踏实工艺；瑕玷是互连总量达到百亿级，从统计学角度势必存在极少失效点位。

但本色上，微型短距铜-铜搀杂键合互连的可靠性优于传统微凸块决议。Chee Ping Lee示意：“对比传统微凸块界面，极短距离的铜对铜搀杂键合互连电阻、电容更低，信号好意思满性更优。不同系统下误码改善幅度受多遑急素影响，但比较过往裸片集成决议，搀杂键合界面均匀性更好，信号衰减进程大幅抑止。”

Lakshmi Jain对此示意认可：“若谋划裕量经过好意思满考证，覆盖制程、电压、温度（PVT）与器件老化全工况，或然误码发生概率会降高出低，仅出现于极小概率统计事件。因此物理层原生误码率（BER）可作念到极低，无需依赖表层通讯公约通过重传、纠错码（ECC）掩盖故障。这种物理层原生可靠性，是高密度搀杂键合互连收罗范围化落地的关节。”

工艺难度将抓续攀升

文中选择1微米节距仅作示例，并非工艺物理极限。前文提到，表面上业界可完了200纳米焊盘节距；异日焊盘节距抓续微缩，还可能需要退换焊盘几何外形。Thomas Pleschke示意：“焊盘尺寸、节距不休缩小后，铜金属占比抓续栽植；为保险整片晶圆均匀性，需要优化焊盘排布为六边形阵列，同期布设编造dummy焊盘。”

搀杂键合属于跨界限复合型时间贫窭，涵盖材料、半导体工艺、机电一体化多学科，产业链全设施深度协同至关遑急。Pleschke称：“从前期研发到量产落地，整条价值链潦倒游企业需紧要密互助，才调攻克搀杂键合各项工艺贫窭。”

跟着搀杂键合期骗普及、芯片互连范围抓续扩张，行业还将面对更多全新挑战，业界也需要抓续翻新决议，完了数百亿乃至数万亿互连点的踏实、高性能、可瞻望量产。

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